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Renesas PCA4738S-42A Especificações Página 29

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28
3851 Group
(Built-in 16 KB ROM)
SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER
MITSUBISHI MICROCOMPUTERS
START/STOP
condition
control register
Oscillation
frequency
f(XIN) (MHz)
Fig. 31 Address data communication format
Fig. 30 Structure of I
2
C START/STOP condition control register
Note: Do not set an odd number to the START/STOP condition set bit (SSC4 to SSC0).
Table 9 Recommended set value to START/STOP condition set bits (SSC4–SSC0) for each oscillation frequency
Main clock
divide ratio
System
clock φ
(MHz)
SCL release time
(µs)
Setup time
(µs)
Hold time
(µs)
8
8
4
2
2
8
2
2
XXX11010
XXX11000
XXX00100
XXX01100
XXX01010
XXX00100
3.375 µs (13.5 cycles)
3.125 µs (12.5 cycles)
2.5 µs (2.5 cycles)
3.25 µs (6.5 cycles)
2.75 µs (5.5 cycles)
2.5 µs (2.5 cycles)
6.75 µs (27 cycles)
6.25 µs (25 cycles)
5.0 µs (5 cycles)
6.5 µs (13 cycles)
5.5 µs (11 cycles)
5.0 µs (5 cycles)
3.375 µs (13.5 cycles)
3.125 µs (12.5 cycles)
2.5 µs (2.5 cycles)
3.25 µs (6.5 cycles)
2.75 µs (5.5 cycles)
2.5 µs (2.5 cycles)
4
1
2
1
b7 b0
I
2
C START/STOP condition
control register
START/STOP condition set bit
S
CL
/S
DA
interrupt pin polarity
selection bit
0 : Falling edge active
1 : Rising edge active
S
CL
/S
DA
interrupt pin selection bit
0 : S
DA
valid
1 : S
CL
valid
Reserved
Do not write “1” to this bit.
SIS SIP
SSC4 SSC3 SSC2 SSC1 SSC0
(S2D : address 0030
16
)
S
S
l
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s
A
S
r
Slave address
1st 7 bits
R
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M
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